package/uboot-lantiq/files/board/infineon/easy50712/ddr_settings_r111.h

   1 /* Settings for Denali DDR SDRAM controller */\r
   2 /* Optimise for Danube Ref Board DDR 166 Mhz - by Ng Aik Ann 29th April */\r
   3 #define MC_DC0_VALUE    0x1B1B\r
   4 #define MC_DC1_VALUE    0x0\r
   5 #define MC_DC2_VALUE    0x0\r
   6 #define MC_DC3_VALUE    0x0\r
   7 #define MC_DC4_VALUE    0x0\r
   8 #define MC_DC5_VALUE    0x200\r
   9 #define MC_DC6_VALUE    0x605\r
  10 #define MC_DC7_VALUE    0x303\r
  11 #define MC_DC8_VALUE    0x102\r
  12 #define MC_DC9_VALUE    0x70a\r
  13 #define MC_DC10_VALUE   0x203\r
  14 #define MC_DC11_VALUE   0xc02\r
  15 #define MC_DC12_VALUE   0x1C8\r
  16 #define MC_DC13_VALUE   0x1\r
  17 #define MC_DC14_VALUE   0x0\r
  18 #define MC_DC15_VALUE   0xf3c  /* WDQS tuning for clk_wr*/\r
  19 #define MC_DC16_VALUE   0xC800\r
  20 #define MC_DC17_VALUE   0xd\r
  21 #define MC_DC18_VALUE   0x300\r
  22 #define MC_DC19_VALUE   0x200\r
  23 #define MC_DC20_VALUE   0xA04  /* A04 for reference board, A03 for Eval board */\r
  24 #define MC_DC21_VALUE   0x1200\r
  25 #define MC_DC22_VALUE   0x1212\r
  26 #define MC_DC23_VALUE   0x0\r
  27 #define MC_DC24_VALUE   0x5e   /* WDQS Tuning for DQS */\r
  28 #define MC_DC25_VALUE   0x0\r
  29 #define MC_DC26_VALUE   0x0\r
  30 #define MC_DC27_VALUE   0x0\r
  31 #define MC_DC28_VALUE   0x510\r
  32 #define MC_DC29_VALUE   0x2d89\r
  33 #define MC_DC30_VALUE   0x8300\r
  34 #define MC_DC31_VALUE   0x0\r
  35 #define MC_DC32_VALUE   0x0\r
  36 #define MC_DC33_VALUE   0x0\r
  37 #define MC_DC34_VALUE   0x0\r
  38 #define MC_DC35_VALUE   0x0\r
  39 #define MC_DC36_VALUE   0x0\r
  40 #define MC_DC37_VALUE   0x0\r
  41 #define MC_DC38_VALUE   0x0\r
  42 #define MC_DC39_VALUE   0x0\r
  43 #define MC_DC40_VALUE   0x0\r
  44 #define MC_DC41_VALUE   0x0\r
  45 #define MC_DC42_VALUE   0x0\r
  46 #define MC_DC43_VALUE   0x0\r
  47 #define MC_DC44_VALUE   0x0\r
  48 #define MC_DC45_VALUE   0x500\r
  49 //#define MC_DC45_VALUE 0x400\r
  50 #define MC_DC46_VALUE   0x0\r